Студопедия
Случайная страница | ТОМ-1 | ТОМ-2 | ТОМ-3
АвтомобилиАстрономияБиологияГеографияДом и садДругие языкиДругоеИнформатика
ИсторияКультураЛитератураЛогикаМатематикаМедицинаМеталлургияМеханика
ОбразованиеОхрана трудаПедагогикаПолитикаПравоПсихологияРелигияРиторика
СоциологияСпортСтроительствоТехнологияТуризмФизикаФилософияФинансы
ХимияЧерчениеЭкологияЭкономикаЭлектроника

Моделирование разработанного проекта цифрового устройства

Читайте также:
  1. II. Предыстория и основная идея проекта (глава)
  2. S 4 ВСПОМОГАТЕЛЬНЫЕ УСТРОЙСТВА КОНТРОЛЬНЫХ ПРИСПОСОБЛЕНИЙ
  3. SSID - это идентификатор сети. Все устройства в одной беспроводной сети должны иметь один и тот же идентификатор
  4. Актуальность проекта
  5. Амер оккупация Японии (1945–1952 гг.). Складывание послевоенного японского полит устройства.
  6. Анализ инвестиционной привлекательности реализации проекта
  7. Анализ производственных ситуаций и имитационное моделирование

В процессе моделирования симулятор определяет, какие сигналы и с какой задержкой разработанное устройство сформирует на выходных выводах. Результаты моделирования симулятор также представляет в виде временных диаграмм.

 

· Определить параметры симулятора, выбрав в главном меню "Processing\Simulator\Tool" ("Процесс\Инструменты Симулятора"). В появившемся окне "Simulator\Tool" в списке "Simulator\mode" ("Режим моделирования") выбрать строку "Timing" ("Временной"). В поле "Simulation input" ("Входные данные для моделирования") по умолчанию имя подготовленного файла временных диаграмм Waveform1.vwf. По желанию разработчика можно ввести другое имя с расширением *. vwf, например, для нашего проектируемого устройства multiplexor.vwf.

 

Примечание: При установке режима "Functional" ("Функциональный") в результате моделирования будут получены идеальные временные диаграммы сигналов выходных узлов, то есть без учета реальных аппаратных задержек. Этот режим целесообразно применять на предварительных этапах проектирования. В режиме "Timing " ("Временной") будут получены диаграммы с задержками сигналов, определяемыми числом элементов на пути распространения сигнала и выбранным типом микросхемы. Кроме того, в режиме "Timing " ("Временной") симулятором обнаруживаются так называемые "Glitches" ("Выбросы"). Они обусловлены не логикой проекта, а двух кратными и более перепадами логического уровня ("дребезг контактов", "состязание сигналов" и т.д.) за промежутки времени, когда по логике проекта эти перепады логического уровня отсутствуют. Эти ложные импульсы могут отрицательно повлиять на работоспособность проектируемого устройства.

 

· Щелкнуть по кнопке с тремя точками справа от поля "Simulation input" ("Входные данные для моделирования") и убедиться в том, что в поле панели "Select File" ("Выбранный файл") занесено имя подготовленного файла временных диаграмм: по умолчанию Waveform1.vwf (в нашем примере magor.vwf).

 

· Щелкнуть по имени подготовленного файла временных диаграмм для возврата в поле "Simulator\Tool". На панели "Simulation period" ("Период моделирования") включить кнопку "Run simulation until all stimuli are used" ("Моделировать, пока все входные сигналы не будут использованы").

· На панели "Simulation options" ("Параметры моделирования") установить "галочку" в строке "Automatically add pins to simulation outputs waveforms" ("Автоматически включить выходные узлы в результирующие временные диаграммы").

 

Установка указанного выше свойства обеспечит автоматическое добавление во временные диаграммы, полученные в результате моделирования, всех существующих выходных узлов с их диаграммами. Это свойство следует выключать, если вы хотите наблюдать диаграммы только части выходных узлов. В этом случае их необходимо ввести вручную. Остальные свойства на панели "Simulation options" ("Параметры моделирования") обеспечивают:

 

§ "Check outputs" ("Контроль выходных диаграмм") – обеспечивает сравнение ожидаемых диаграмм выходных сигналов, сформированных проектировщиком в файле *. vwf, с реально полученными в результате моделирования, то есть с учетом временных задержек ЛЭ.

 

§ "Setup and hold time violation detection" ("Обнаружение нарушений времени предустановки и времени удержания") – контролирует процесс моделирования на наличие нарушений параметров "время предустановки " и "время удержания" и сообщает о них в окне сообщений.

 

§ "Glitch detection" ("Обнаружение выбросов") – контролирует процесс временного моделирования на наличие выбросов и сообщает о них в окне сообщений.

 

§ "Overwrite simulation input file with simulation results" ("Обновление входного файла моделирования *. vwf с добавлением результатов моделированием") – включает режим обновления файла временных диаграмм.

 

· Закрыть окно "Simulation options" ("Параметры моделирования").

 

· Выбрать в главном меню "Processing\Start Simulation" ("Процессы\Запуск Моделирования"). По умолчанию на экране появится окно "Simulation Report" ("Отчет о моделировании"), а в окне состояния процесса начнет отражаться объем выполнения процесса моделирования. После завершения моделирования на экране появится информационное окно с сообщением о завершении процесса. Его следует закрыть, щелкнув по кнопке "OK".

 

Примечание: Процесс моделирования можно бы запустить и непосредственно из окна "Simulation options" ("Параметры моделирования"), щелкнув по кнопке "Start". Однако в этом случае оказывается несколько более длинным процесс вывода результатов моделирования на экран.

Если моделирование завершилось успешно, то на экране окно "Simulation Report" ("Отчет о моделировании"). Окно состоит из двух частей: левой - "Report Window Contents" ("Содержание Окна Отчета"), в которой можно выбрать необходимый раздел отчета о моделировании, и правой - "Report Window Section" ("Демонстрационная Секция Отчета"), в которой представлено содержание выбранного раздела отчета. По умолчанию в демонстрационной секции представлен раздел "Simulation\ Simulation Waveform" ("Симулятор\Диаграммы Моделирования")period" ("Период моделирования"). Если раздел оказался неподключенным, например, при запуске симулятора из окна "Simulator Tool" ("Инструменты Симулятора"), его следует подключить, выбрав соответствующую строку в списке "Report Window Contents" ("Содержание Окна Отчета").

Как следует из содержания правого окна моделирования, к диаграммам входных узлов добавлена диаграмма выходного узла у. Содержание диаграммы соответствует таблице истинности мультиплексора, что демонстрирует правильное функционирование разработанного устройства. На диаграмме выходного узла y также видно реальную задержку выходных сигналов по отношению к входным сигналам. Величину временной задержки можно точно измерить.

Получаем:

 

 

 


Дата добавления: 2015-12-08; просмотров: 78 | Нарушение авторских прав



mybiblioteka.su - 2015-2024 год. (0.008 сек.)